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1. 熟练掌握vivado、ISE、Quatus等开发工具,熟练使用Verilog/VHDL语言;
2. 有一定的硬件基础,可以理解原理图,描述约束关系;
3. 熟悉SRIO、JESD204B、Serdes等高速接口;
4. 有射频调试经验者优先,掌握ADI任意一款ADC/DAC者优先;
5.工作内容涉及硬件平台的FPGA底层代码设计、VPX ASSAC 标准板卡调试、高速信号采集卡、软件无线电设备研发等;
6. 有通信和信号处理经验的优先。
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公司介绍
工商信息
- 公司名称龙文华丰(北京)科技有限公司
- 法定代表人田耘
- 成立日期2010-07-06
- 企业类型有限责任公司(自然人投资或控股)
- 经营状态存续
- 注册资金3006.07万人民币
工作地址
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精选职位
页面更新时间:2025-11-26



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