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职位详情

• 北京
• 3-5年
• 硕士

• 有数字前端设计师经验
• 数模混合芯片
• 高速接口
• RISC-V
• ARM
• 成功流片经验
• Verilog/System Verilog
• 3-5年数字前端设计经验

岗位职责： 1、完成Spec指标拆解，模块划分，完成RTL代码设计。 2、与流程工程师深度合作，完成综合，时序收敛，版图布局等，达成PPA目标。 任职要求： 1、硕士及以上学历，微电子、电子工程、通信等电子类相关专业； 2、熟悉数字电路设计，熟练使用Cadence直聘、 Synopsys 等仿真工具；有数模混合芯片流片经验者优先； 3、自我激励、积极主动，以结果为导向，学习意愿强； 4、具备较强的执行力和时间管理能力； 5、善于沟通，具有良好的团队合作精神。 公司提供：具来自BOSS直聘备竞争力的薪酬；股权激励；全面的福利保障；务实平等的工作环境；kanzhun与行业内顶尖设计、应用和市场团队一起共事并成长。