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职位详情

• 长沙
• 3-5年
• 硕士

• 高速总线协议
• ASIC
• 前端EDA工具
• 高速接口
• 3-5年数字前端设计经验
• Verilog/System Verilog
• 英文读写能力
• 成功流片经验
• 有数字前端设计师经验
• GPU

岗位职责： 1. 负责数字IC前端直聘设计工作，包括RTL代码开发、逻辑综合、时序优化及功耗分析； 2. 参与芯片架构定义与模块划分，主导关键模块（如BUS-NOC、DDR控制器、DPU显示子系统）的RTL实现； 3. 支持验证团队完来自BOSS直聘成模块级和系统级验证，确保设计符合功能需求； 4. 针对高速接口（如PCle/UCle、HDMI_TX、DP/eDP）进行协议分析与时序收敛； 5. 编写技术文档，参与芯片流片前后的调试与问题定位。 任职要求： 1. 微电子/电子工程/计算机相关专业，硕士BOSS直聘及以上学历，3年以上数字IC设计经验； 2. 精通Verilog/SystemVerilog，熟悉ASIC设计流程及EDA工具（VCS、DC、PT等）； 3. 有以下任一领域实际项目经验： 3.1. 总线协议：BUS-NOC、AXI/AHB/APB等； 3.2. 高速接口：DDR4/5、PCle Gen3/4/5、HDMI/DP/eDP； 3.3. 显示处理单元（DPU）相关设计； 4. 有以下特征优先 4.1. 熟悉低功耗设计方法（UPF）boss和时序约束者优先； 4.2. 良好的团队沟通和协调能力，较强的学习能力、责任感及进取精神。