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- FPGA开发
- 电路设计
- 高速接口
- 接口设计
1. 根据规格书,撰写模块或者子系统的设计文档
2. 完成模块的RTL编码和IP集成设计,对模块做综合、时序优化和可测试性设计
3. 协助FPGA/硬件加速器工程师和软件工程师完成FPGA原型/硬件加速器测试
4. 根据后端反馈改进模块设计和代码
5. 负责10G~800G PCS层的接口设计和FEC设计
6. 负责10G~800G MAC层的接口设计
7. 负责数字接口和serdes的接口集成
任职资格:
1, 精通IEEE802.3协议,相关的以太网和Serdes接口协议
2, 具备10G~800G的PCS层接口或者FEC设计经验
3, 具备10G~800G的MAC层接口设计经验
4, 至少有2款以上高速接口(100G及以上)的芯片流片经验

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工商信息
- 公司名称苏州盛科通信股份有限公司
- 法定代表人吕宝利
- 成立日期2005-01-31
- 企业类型股份有限公司(外商投资、上市)
- 经营状态存续
- 注册资金41000万人民币
工作地址
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页面更新时间:2025-05-12