职位&公司对比
职位详情
- 苏州
- 3-5年
- 本科
- FPGA开发
- 电路设计
- 高速接口
- 接口设计
工作职责： 1. 根据规格书，撰写模块或者子系统的设计文档 2. 完成模块的RTL编码和IP集成设计，对模块做综合、时序优化和可测试性设计 3. 协助FPGA/硬件加速器工程师和软件工程师完成FPGA原型/硬件加速器测试 4. 根据后端反馈改进模块设BOSS直聘计和代码 5. 负责10G~800G PCS层的接口设计和FEC设计 6. 负直聘责10G~800G MAC层的接口设计 7. 负责kanzhun数字接口和serdes的接口集成 任职资格： 1, 精通IEEE802.3协议，相关的以太网和Serdes接口协议 2, 具备10G~800G的PCS层接口或者FEC设计经验 3, 具备10G~800G的MAC层接口设计经验 4, 至少有2款以上高速接口(100kanzhunG及以上)的芯片流片经验
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- 苏州
- 3-5年
- 本科
- 电路设计
- VHDL
- FPGA开发
- Verilog
- ModelSim
1.专业知识和技能： 熟悉基本的数字逻辑BOSS直聘电路设计，包括组合逻辑和时序逻辑； 熟练掌握至少来自BOSS直聘一种硬件描述语来自BOSS直聘言，如VHDL或者Verilog； 熟悉FPGA和ASIC的开发流程； 能够编写、仿真和验证HDL代码。 2.工具类技能： 能够使用nLint、Spyglass、CDC等代码规则、异步检查工具； 能够使用VCS、Modelsim等仿真工具； 能够使用DVE、Verdi等调试和boss可视化工具用于调试和性能分析； 3. 其它加分项技能： 熟悉Matlab用于数字计算和数据分析； 熟悉4G、5G物理层基带实现 有polar ldpc译码设计经验
技能解析
专有技能
- 设计文档
- 软件工程
- 系统的设计
- 模块设计
相同技能
- 设计经验
- FPGA
数据来自CSL职业科学研究室
技能解析
专有技能
- 电路设计
- ASIC
- 性能分析
- 和数据分析
- 数据分析
- 可视化工具
- 开发流程
相同技能
- 设计经验
- FPGA
数据来自CSL职业科学研究室
工作时间
上午09:00 - 下午06:00
双休 、 弹性工作
公司福利
- 五险一金
- 定期体检
- 年终奖
- 股票期权
- 带薪年假
- 员工旅游
- 节日福利
推荐对比
更新于 2025-05-13
电子营业执照
京公网安备11010502032801